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數(shù)字電路設(shè)計(jì)及VerilogHDL實(shí)現(xiàn)（2019年1月第2版）
| 發(fā)布用戶：撒旦 | 發(fā)布時(shí)間：2023-01-13 |
| 文件類別：技術(shù)論文 | 文件大小：82.58MB |
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資料描述：
數(shù)字電路設(shè)計(jì)及VerilogHDL實(shí)現(xiàn)（康磊 李潤洲2019年1月第2版）